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RISC-V结构逻辑图

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  • TA的每日心情
    奋斗
    2021-1-15 13:53
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    [LV.4]

    发表于 2020-8-21 01:01:19 | 显示全部楼层 |阅读模式

    有人预言,RISC-V或将是继Intel和Arm之后的第三大主流处理器体系。欢迎访问全球首家只专注于RISC-V单片机行业应用的中文网站

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    国内芯片技术交流-RISC-V结构逻辑图risc-v单片机中文社区(1)


    说明:

    执行6级流水作业:

    1. fetch(取指)

    2. decode(译码)

    3. dispatch/renaming(分发/重命名)

    4. select/wakeup(选择/唤醒)

    5. execution/mem access/finish(执行/存取/结束)

    6. complete/retire(完成/恢复)


    六级流水作业的另一种划分说法:

    The six-stage pipeline should be divided into the following stages:

    • Instruction Fetch (取指)-- request instruction from iMem and update PC
    • Decode(译码) -- receive response from iMem and decode instruction
    • Register Fetch(取寄存器) -- read from the register file
    • Execute(执行) -- execute the instruction and redirect the processor if necessary
    • Memory(存储) -- send memory request to dMem
    • Write Back(回写) -- receive memory response from dMem (if applicable) and write to register file




    设计完成后的芯片:


    国内芯片技术交流-RISC-V结构逻辑图risc-v单片机中文社区(2)


    1


    国内芯片技术交流-RISC-V结构逻辑图risc-v单片机中文社区(3)

    2

    本篇完,感谢关注:RISC-V单片机中文网





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    RISCV作者优文
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